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MAX3673 低抖动频率合成器，可选择输入参考时钟

业内最佳的抖动指标，优于SerDes参考时钟规范

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状况：生产中。

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MAX3673低抖动频率合成器，可接收两路基准时钟输入，并产生九路相位对齐的输出。该器件具有40kHz抖动传递带宽、0.3ps_RMS (12kHz至20MHz)的集成相位抖动和优异的电源噪声抑制(PSNR)，非常适合在无线基站系统中进行抖动去除、频率转换和时钟分配。

MAX3673采用+3.3V单电源供电，典型功耗为400mW。IC采用8mm x 8mm、56引脚TQFN封装，工作温度范围为-40°C至+85°C。

现备有评估板： MAX3673EVKIT

关键特性 应用/使用

两路基准时钟输入：LVPECL
9路相位对齐的时钟输出：LVPECL
输入频率：61.44MHz、122.88MHz、245.76MHz、307.2MHz
输出频率：61.44MHz、122.88MHz、153.6MHz、245.76MHz、307.2MHz
低抖动：0.3ps_RMS (12kHz至20MHz)
两路基准时钟均带有时钟故障指示
外部反馈提供零延迟功能
低输出摆幅：典型值为20ps

3G无线基站
时钟分配
频率变换
抖动抑制

Key Specifications: Clock Generators

Part Number

Applications

f_IN
(MHz)

f_OUT
(MHz)

Fixed or Continuous Frequency

Output Levels

Out-
puts

PLLs

Spread Spectrum

Output Jitter
(ps)

V_SUPPLY
(V)

Package/Pins

Price

min

max

min

max

RMS

See Notes

MAX3673 NEW!

3G Wireless Base Stations

Clock Distribution

Frequency Translation

Jitter Cleanup

61.44

307.2

61.44

307.2

Fixed

LVPECL

0.3

3.3

TQFN/56

$10.85 @1k

查看所有Clock Generators (27)

图表

MAX3673：功能框图
功能框图

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参考文献： 19-4442; Rev. 0; 2009-02-10
本页最后一次更新: 2009-07-08