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时钟发生器与分配器
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利用PLL技术取代振荡器模块
Maxim的PLL技术能够省去昂贵的振荡器模块。
利用集成PLL和低频晶体，Maxim的时钟发生器IC能够满足网络标准的要求，提供极低的抖动和出色的PSNR。Maxim的时钟发生器IC能够提供与振荡器模块相当的性能指标，并可有效降低成本、提高系统可靠性、节省电路板尺寸。
Maxim时钟发生器有效降低成本
高速网络接口需要高频时钟，典型时钟频率高于100MHz。
高频振荡器模块使用非常薄的晶体，例如，156.25MHz的晶体厚度只有10µm。为了获得如此小的尺寸，必须采用反台工艺制造晶体，这种晶体的制程难度很大，而且价格昂贵。
Maxim基于时钟发生器的PLL允许使用较厚的低成本、低频率晶体—例如：25MHz—合成高频网络时钟。如果系统板需要多个谐波频率的时钟，利用一片时钟发生器IC即可替代多个振荡器模块，进一步降低了系统的整体成本。
Maxim时钟发生器有效提高可靠性
制造过程中的热应力以及运输途中的冲击和震动都会造成超薄晶体晶格应变的积累。超薄晶体很容易破碎，当在用户端完成设备安装后，由于晶格释放很容易造成晶体破裂。这些机械元件将成为系统失效的主要因素。
利用较厚的晶体取代超薄晶体可有效提高系统的可靠性。
Maxim时钟发生器有效节省电路板空间
利用一个低频晶体和集成的扇出缓冲器提供多路时钟输出，Maxim时钟可以大大降低对电路板空间的需求。
有关时钟阵列减小系统尺寸、降低成本和功耗的更多信息，请参考时钟阵列集成。
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